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synced 2025-07-31 19:24:33 +02:00
hal: Explicit setting of efuse time settings
EFUSE_PWR_ON_NUM in C3 has default value = 0x2880, now = 0x3000
This commit is contained in:
@@ -30,6 +30,9 @@ IRAM_ATTR uint32_t efuse_hal_get_minor_chip_version(void)
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void efuse_hal_set_timing(uint32_t apb_freq_hz)
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void efuse_hal_set_timing(uint32_t apb_freq_hz)
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{
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{
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(void) apb_freq_hz;
|
(void) apb_freq_hz;
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efuse_ll_set_dac_num(0xFF);
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efuse_ll_set_dac_clk_div(0x28);
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efuse_ll_set_pwr_on_num(0x3000);
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efuse_ll_set_pwr_off_num(0x190);
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efuse_ll_set_pwr_off_num(0x190);
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int xtal = clk_ll_xtal_load_freq_mhz();
|
int xtal = clk_ll_xtal_load_freq_mhz();
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HAL_ASSERT(xtal == 40 || xtal == 26);
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HAL_ASSERT(xtal == 40 || xtal == 26);
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@@ -115,6 +115,21 @@ __attribute__((always_inline)) static inline void efuse_ll_set_conf_write_op_cod
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EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
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EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
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}
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}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_num(uint8_t val)
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{
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EFUSE.dac_conf.dac_num = val;
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}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_clk_div(uint8_t val)
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{
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EFUSE.dac_conf.dac_clk_div = val;
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|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_on_num(uint16_t val)
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{
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EFUSE.wr_tim_conf1.pwr_on_num = val;
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|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
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{
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{
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EFUSE.wr_tim_conf2.pwr_off_num = value;
|
EFUSE.wr_tim_conf2.pwr_off_num = value;
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@@ -30,6 +30,9 @@ IRAM_ATTR uint32_t efuse_hal_get_minor_chip_version(void)
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void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
void efuse_hal_set_timing(uint32_t apb_freq_hz)
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||||||
{
|
{
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(void) apb_freq_hz;
|
(void) apb_freq_hz;
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|
efuse_ll_set_dac_num(0xFF);
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|
efuse_ll_set_dac_clk_div(0x28);
|
||||||
|
efuse_ll_set_pwr_on_num(0x3000);
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||||||
efuse_ll_set_pwr_off_num(0x190);
|
efuse_ll_set_pwr_off_num(0x190);
|
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}
|
}
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@@ -120,6 +120,21 @@ __attribute__((always_inline)) static inline void efuse_ll_set_conf_write_op_cod
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EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
|
EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
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||||||
}
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}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_num(uint8_t val)
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{
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|
EFUSE.dac_conf.dac_num = val;
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|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_clk_div(uint8_t val)
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{
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|
EFUSE.dac_conf.dac_clk_div = val;
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|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_on_num(uint16_t val)
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|
{
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|
EFUSE.wr_tim_conf1.pwr_on_num = val;
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||||||
|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
||||||
{
|
{
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||||||
EFUSE.wr_tim_conf2.pwr_off_num = value;
|
EFUSE.wr_tim_conf2.pwr_off_num = value;
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@@ -29,6 +29,9 @@ IRAM_ATTR uint32_t efuse_hal_get_minor_chip_version(void)
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void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
||||||
{
|
{
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||||||
(void) apb_freq_hz;
|
(void) apb_freq_hz;
|
||||||
|
efuse_ll_set_dac_num(0xFF);
|
||||||
|
efuse_ll_set_dac_clk_div(0x28);
|
||||||
|
efuse_ll_set_pwr_on_num(0x3000);
|
||||||
efuse_ll_set_pwr_off_num(0x190);
|
efuse_ll_set_pwr_off_num(0x190);
|
||||||
}
|
}
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|
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||||||
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@@ -115,6 +115,21 @@ __attribute__((always_inline)) static inline void efuse_ll_set_conf_write_op_cod
|
|||||||
EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
|
EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
|
||||||
}
|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_num(uint8_t val)
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{
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|
EFUSE.dac_conf.dac_num = val;
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||||||
|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_dac_clk_div(uint8_t val)
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||||||
|
{
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|
EFUSE.dac_conf.dac_clk_div = val;
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|
}
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__attribute__((always_inline)) static inline void efuse_ll_set_pwr_on_num(uint16_t val)
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|
{
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||||||
|
EFUSE.wr_tim_conf1.pwr_on_num = val;
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|
}
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||||||
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
||||||
{
|
{
|
||||||
EFUSE.wr_tim_conf2.pwr_off_num = value;
|
EFUSE.wr_tim_conf2.pwr_off_num = value;
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@@ -29,7 +29,60 @@ IRAM_ATTR uint32_t efuse_hal_get_minor_chip_version(void)
|
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|
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void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
||||||
{
|
{
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||||||
ets_efuse_set_timing(apb_freq_hz);
|
uint32_t tsup_a;
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|
uint32_t tpgm;
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|
uint32_t thp_a;
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||||||
|
uint32_t tpgm_inact;
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|
uint32_t clk_div;
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|
uint32_t power_on;
|
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|
uint32_t power_off;
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|
uint32_t tsur_a;
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|
uint32_t trd;
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|
uint32_t thr_a;
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||||||
|
if (apb_freq_hz == 80000000) {
|
||||||
|
tsup_a = 0x2;
|
||||||
|
tpgm = 0x320;
|
||||||
|
thp_a = 0x2;
|
||||||
|
tpgm_inact = 0x4;
|
||||||
|
clk_div = 0xA0;
|
||||||
|
power_on = 0xA200;
|
||||||
|
power_off = 0x100;
|
||||||
|
tsur_a = 0x2;
|
||||||
|
trd = 0x4;
|
||||||
|
thr_a = 0x2;
|
||||||
|
} else if (apb_freq_hz == 40000000) {
|
||||||
|
tsup_a = 0x1;
|
||||||
|
tpgm = 0x190;
|
||||||
|
thp_a = 0x1;
|
||||||
|
tpgm_inact = 0x2;
|
||||||
|
clk_div = 0x50;
|
||||||
|
power_on = 0x5100;
|
||||||
|
power_off = 0x80;
|
||||||
|
tsur_a = 0x1;
|
||||||
|
trd = 0x2;
|
||||||
|
thr_a = 0x1;
|
||||||
|
} else { // 20000000 or 5000000 or 10000000
|
||||||
|
tsup_a = 0x1;
|
||||||
|
tpgm = 0xC8;
|
||||||
|
thp_a = 0x1;
|
||||||
|
tpgm_inact = 0x1;
|
||||||
|
clk_div = 0x28;
|
||||||
|
power_on = 0x2880;
|
||||||
|
power_off = 0x40;
|
||||||
|
tsur_a = 0x1;
|
||||||
|
trd = 0x1;
|
||||||
|
thr_a = 0x1;
|
||||||
|
}
|
||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF1_REG, EFUSE_TSUP_A, tsup_a);
|
||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF0_REG, EFUSE_TPGM, tpgm);
|
||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF0_REG, EFUSE_THP_A, thp_a);
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||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF0_REG, EFUSE_TPGM_INACTIVE, tpgm_inact);
|
||||||
|
REG_SET_FIELD(EFUSE_DAC_CONF_REG, EFUSE_DAC_CLK_DIV, clk_div);
|
||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF1_REG, EFUSE_PWR_ON_NUM, power_on);
|
||||||
|
REG_SET_FIELD(EFUSE_WR_TIM_CONF2_REG, EFUSE_PWR_OFF_NUM, power_off);
|
||||||
|
REG_SET_FIELD(EFUSE_RD_TIM_CONF_REG, EFUSE_TSUR_A, tsur_a);
|
||||||
|
REG_SET_FIELD(EFUSE_RD_TIM_CONF_REG, EFUSE_TRD, trd);
|
||||||
|
REG_SET_FIELD(EFUSE_RD_TIM_CONF_REG, EFUSE_THR_A, thr_a);
|
||||||
}
|
}
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||||||
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void efuse_hal_read(void)
|
void efuse_hal_read(void)
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@@ -50,6 +50,9 @@ IRAM_ATTR uint32_t efuse_hal_get_minor_chip_version(void)
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|||||||
void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
void efuse_hal_set_timing(uint32_t apb_freq_hz)
|
||||||
{
|
{
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||||||
(void) apb_freq_hz;
|
(void) apb_freq_hz;
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||||||
|
efuse_ll_set_dac_num(0xFF);
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||||||
|
efuse_ll_set_dac_clk_div(0x28);
|
||||||
|
efuse_ll_set_pwr_on_num(0x3000);
|
||||||
efuse_ll_set_pwr_off_num(0x190);
|
efuse_ll_set_pwr_off_num(0x190);
|
||||||
}
|
}
|
||||||
|
|
||||||
|
@@ -120,6 +120,21 @@ __attribute__((always_inline)) static inline void efuse_ll_set_conf_write_op_cod
|
|||||||
EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
|
EFUSE.conf.op_code = EFUSE_WRITE_OP_CODE;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
__attribute__((always_inline)) static inline void efuse_ll_set_dac_num(uint8_t val)
|
||||||
|
{
|
||||||
|
EFUSE.dac_conf.dac_num = val;
|
||||||
|
}
|
||||||
|
|
||||||
|
__attribute__((always_inline)) static inline void efuse_ll_set_dac_clk_div(uint8_t val)
|
||||||
|
{
|
||||||
|
EFUSE.dac_conf.dac_clk_div = val;
|
||||||
|
}
|
||||||
|
|
||||||
|
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_on_num(uint16_t val)
|
||||||
|
{
|
||||||
|
EFUSE.wr_tim_conf1.pwr_on_num = val;
|
||||||
|
}
|
||||||
|
|
||||||
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
__attribute__((always_inline)) static inline void efuse_ll_set_pwr_off_num(uint16_t value)
|
||||||
{
|
{
|
||||||
EFUSE.wr_tim_conf2.pwr_off_num = value;
|
EFUSE.wr_tim_conf2.pwr_off_num = value;
|
||||||
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